【摘要】：在抗輻射GNSS接收機的研發過程中,由于Xilinx 600萬門FPGA在軌單粒子翻轉(Single Event Upset,SEU)效應嚴重,而自主研發抗輻射GNSS接收機ASIC是最有效的解決辦法。以航天五院重點型號項目"XX-2"項目為依托,在國內首次采用65 nm抗輻射工藝,用單個ASIC芯片實現了1 200萬門規模的星載抗輻射GNSS接收機ASIC。但是,對此款新工藝/大規模/功能復雜的ASIC芯片進行單粒子功能中斷測定是一個難題。通過在FPGA上模擬GNSS數字中頻信號和DSP配置輸入,然后由芯片的EMIF接口實時讀取芯片內部關鍵數據來進行SEU/SEFI的判斷,并設計了SEFI判斷準則和相應的輻照實驗實現方案。
[Abstract]:In the course of research and development of anti-radiation GNSS receiver, due to the serious effect of Xilinx 6 million gate FPGA in orbit single-particle flip-over (Single Event Upset,SEU (Single Event Upset,SEU), the self-developed anti-radiation GNSS receiver ASIC is the most effective solution. Based on the "XX-2" project of the key model project of the Fifth Academy of Astronautics, 65 nm anti-radiation technology was used for the first time in China, and a 12 million-gate spaceborne anti-radiation GNSS receiver ASIC. was realized with a single ASIC chip. However, it is a difficult problem to measure the single-particle functional interruption of the new process / large-scale / complex ASIC chip. By simulating the GNSS digital intermediate frequency signal and DSP configuration input on FPGA, and then reading the key data in the chip by EMIF interface of the chip in real time, the SEU/SEFI judgment is carried out, and the SEFI judgment criterion and the corresponding irradiation experiment realization scheme are designed.
【作者單位】： 中國航天電子技術研究院772所;
【分類號】：TN965.5

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本文編號：2451457