本文關鍵詞： 高壓直流輸電 次同步振蕩 附加次同步振蕩阻尼控制器 附加勵磁阻尼控制器 靜態無功發生器　出處：《華北電力大學(北京)》2014年碩士論文　論文類型：學位論文

【摘要】：在我國能源與電力負荷分布極不均勻與電力系統互聯趨勢的大背景下,高壓直流輸電技術被廣泛應用于電力系統中,由直流輸電引起的次同步振蕩問題也越來越引起注意,因此,為了保證汽輪發電機組安全運行,對高壓直流輸電(HVDC)引起的次同步振蕩(SSO)問題抑制措施的研究具有相當重要的意義。論文以由HVDC引發SSO抑制措施為研究重點,首先對網側抑制措施寬頻帶附加次同步阻尼控制器(SSDC)的抑制機理和設計思路進行了論述；在建立SSDC控制回路的基礎上,對SSDC產生電氣阻尼表達式進行了理論推導,定量揭示了SSDC的抑制能力,并給出了SSDC抑制效果影響因素與抑制能力的表達式；最后針對典型HVDC與串補外送系統在HVDC整流側設計SSDC,并通過時域仿真對SSDC對SSO抑制的有效性及上述理論分析的正確性進行了驗證。對廠側抑制措施附加勵磁阻尼控制器(SEDC)與靜態無功發生器(SVG)的抑制機理和設計思路進行了論述,著重對SVG上層控制策略進行了設計；在對兩種抑制措施控制回路分析的基礎上,分別對SEDC與SVG產生電氣阻尼表達式進行了理論推導,定量揭示兩種措施的抑制能力,并給出了兩種措施抑制效果影響因素抑制能力的表達式；最后針對典型HVDC與串補外送系統在廠側設計SEDC與SVG,并通過時域仿真對SEDC、SVG對SSO抑制的有效性及上述理論分析的正確性進行了驗證。在對典型系統抑制措施分析建模上,針對實際情況中可能出現的各抑制措施抑制能力不足的現象,提出了在網側采取SSDC與在廠側采取SEDC與SVG共同協調抑制由HVDC引起的SSO的策略；從原理上分析了SEDC與SVG在抑制SSO時的能夠進行共同協調抑制的機理,并通過對電氣阻尼進行理論推導提出了各抑制措施在抑制能力上的等價指標,最后通過時域仿真驗證了協調抑制與抑制能力等價的正確性。
[Abstract]:Under the background of uneven distribution of energy and power load and interconnection of power system, HVDC technology is widely used in power system. The problem of subsynchronous oscillation caused by DC transmission has been paid more and more attention, therefore, in order to ensure the safe operation of turbogenerator. It is of great significance to study the suppression measures of subsynchronous oscillation (SSOs) caused by HVDC. The emphasis of this paper is on SSO suppression caused by HVDC. Firstly, the suppression mechanism and design idea of broadband additional sub-synchronous damping controller (SSDC) are discussed. Based on the establishment of SSDC control loop, the expression of electrical damping produced by SSDC is derived theoretically, and the restraining ability of SSDC is revealed quantitatively. The factors influencing the inhibition effect of SSDC and the expression of its inhibition ability are also given. Finally, SSDC is designed on the HVDC rectifier side for typical HVDC and serial compensation outputting system. The validity of SSDC to SSO suppression and the correctness of the above theoretical analysis are verified by time-domain simulation. The additional excitation damping controller (SEDC) and static reactive power generator (SvG) are applied to the factory side suppression measures. The inhibition mechanism and design idea of SVG are discussed. The upper control strategy of SVG is mainly designed. Based on the analysis of the control loops of the two kinds of suppression measures, the expressions of electrical damping produced by SEDC and SVG are deduced theoretically, and the inhibition ability of the two measures is revealed quantitatively. The expression of the inhibition ability of two kinds of measures is given. Finally, SEDC and SVG are designed on the factory side for typical HVDC and serial compensation system, and SEDC is simulated in time domain. SVG verifies the validity of SSO suppression and the correctness of the above theoretical analysis. In view of the actual situation may occur in the inhibition of the various measures of the phenomenon of inadequate capacity. The strategy of adopting SSDC on the network side and adopting SEDC and SVG on the factory side to coordinate the inhibition of SSO caused by HVDC is put forward. The mechanism that SEDC and SVG can coordinate the inhibition of SSO is analyzed in principle. Through the theoretical derivation of the electrical damping, the equivalent indexes of the inhibition ability of the various suppression measures are put forward. Finally, the correctness of the equivalence between the coordinated suppression and the suppression ability is verified by the time domain simulation.
【學位授予單位】：華北電力大學(北京)
【學位級別】：碩士
【學位授予年份】：2014
【分類號】：TM712

【參考文獻】

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本文編號：1471134